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深度解析高速串行信号的误码测试

发布日期:2024-06-15 16:41    点击次数:138

当前,高速IEEE ETH以太网主流速率已经从10G支持到100G、200G、400G,消费电子类的高速总线USB3/4/PCIE6的信号速率已经覆盖了从2.5G到64Gbps的速率范围,高速FPGA的串行高速接口速率则从8Gbps猛增到28Gbps,DSP和ADC/DAC从3Gbps过度到32Gbps。随着数字电路工作速度的提高,PCB、连接器、背板上信号的传输速率也越来越高,其中串行数据通信在传输中占据主导地位。

高信号完整性对于实现故障安全操作至关重要。要满足高速传输的性能预期,特别是高速接收端的性能, 接收端容限测试至关重要。RX接收端是整个高速链路的最终环节,接收端测试由于在芯片内部,在绝大多数场景无法直接观测信号完整性问题。

本期线上直播研讨会,将深入讲解当前高速信号的发展趋势、挑战及难点,分析高速串行信号传输的原理并讲解如何进行高速串行信号的误码测试,带您全面掌握高速误码分析仪的基本概念、原理、框架,并剖析如何通过误码分析仪注抖和加噪来完成压力眼测试,同时将与大家探讨高速误码分析仪的典型应用如高速互联、高速芯片、数据中心、高速背板、光模块、光通信等。

Speaker

演讲嘉宾

苏水金

中星联华科技技术支持总监

《测试测量加油站》公众号创始人,具有二十多年电子测试测量经验,对实时示波器、频谱分析仪、模拟信号源、矢量信号源、误码仪、取样示波器、TDR、AWG、逻辑分析仪、采集记录回放仪、信道模拟器等仪器非常熟悉;并在高速信号完整性、电源完整性、半导体测试、ADC/DAC、量子信息、光通信、汽车电子、仪器编程、计量校准、雷达、通信、电子对抗、复杂电磁环境,相控阵天线等领域的测试有深入研究。



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